FPGA时序约束与分析 pdf下载

第1章 时序约束概述
1．1 什么是时序约束
1．2 为什么要做时序约束
1．3 时序约束的基本路径
1．4 时序约束的基本流程
1．5 时序约束的主要方法
1．5．1 使用GUI输入约束
1．5．2 手动输入约束
1．6 约束文件管理

第2章 基本的时序路径
2．1 时钟的基本概念
2．1．1 时钟定义
2．1．2 时钟偏差
2．2 建立时间与保持时间
2．3 寄存器到寄存器的时序路径分析
2．3．1 数据路径和时钟路径
2．3．2 数据到达路径和数据需求路径
2．3．3 启动沿、锁存沿、建立时间关系和保持时间关系
2．3．4 寄存器到寄存器路径分析
2．4 引脚到寄存器的时序路径分析
2．4．1 系统同步接口与源同步接口
2．4．2 系统同步接口的路径分析
2．4．3 源同步接口的路径分析
2．5 寄存器到引脚的时序路径分析
2．5．1 系统同步接口的路径分析
2．5．2 源同步接口的路径分析
2．6 引脚到引脚的时序路径分析

第3章 主时钟与虚拟时钟约束
3．1 主时钟约束
3．1．1 主时钟约束语法
3．1．2 识别设计时钟
3．2 主时钟约束实例
实例3．1：引脚输入的主时钟约束
实例3．2：引脚输入的主时钟约束
实例3．3：高速传输器输出的主时钟约束
实例3．4：硬件原语输出的主时钟约束
实例3．5：差分信号的主时钟约束
3．3 主时钟约束分析
实例3．6：使用GUI约束输入时钟引脚
实例3．7：Clocking Wizard IP主时钟自动约束
实例3．8：查看主时钟时序路径的分析报告
实例3．9：跨时钟域的时序分析
3．4 虚拟时钟约束
3．5 虚拟时钟约束实例
实例3．10：系统同步接口pin2reg的虚拟时钟约束
实例3．11：系统同步接口reg2pin的虚拟时钟约束
3．6 时钟特性约束
3．6．1 时钟抖动与不确定性约束语法
3．6．2 时钟抖动
3．6．3 时钟不确定性
3．7 时钟抖动与不确定性约束实例
实例3．12：使用GUI约束时钟抖动和不确定时间
实例3．13：时钟抖动约束分析
实例3．14：时钟不确定性约束分析
3．8 时钟延时约束语法
3．9 时钟延时约束实例
实例3．15：查看FPGA内部时钟延时、时钟偏斜计算
实例3．16：输入时钟的延时约束

第4章 衍生时钟约束
4．1 衍生时钟定义
4．1．1 自动衍生时钟约束
4．1．2 手动衍生时钟约束
4．2 衍生时钟约束语法
4．3 衍生时钟约束实例
实例4．1：使用GUI约束衍生时钟
实例4．2：2分频的衍生时钟
实例4．3：4/3倍频的衍生时钟

第5章 I/O接口约束
5．1 输入接口约束语法
5．2 输入接口约束实例
实例5．1：以主时钟为同步时钟的输入引脚约束
实例5．2：以虚拟时钟为同步时钟的输入引脚约束
实例5．3：指定最大和最小延时值的输入引脚约束
实例5．4：参考时钟下降沿的输入引脚约束
实例5．5：同时指定同步时钟和参考时钟的输入引脚约束
实例5．6：多组参考组合的输入引脚约束
5．3 输入接口约束分析
实例5．7：图像传感器输入引脚约束
实例5．8：SPI接口的输入引脚约束
5．4 输出接口约束语法
5．5 输出接口约束实例
实例5．9：以主时钟为同步时钟的输出引脚约束
实例5．10：以虚拟时钟为同步时钟的输出引脚约束
实例5．11：同时指定时钟上升沿和下降沿的输出引脚约束
5．6 输出接口约束分析
实例5．12：VGA驱动输出引脚约束
实例5．13：SPI接口输出引脚约束

第6章 时序例外约束
6．1 为何要做时序例外约束
6．2 时序例外约束分类
6．3 时序约束的推荐顺序

第7章 多周期约束
7．1 多周期约束语法
7．2 多周期约束实例
实例7．1：同频同相时钟的多周期约束
实例7．2：同频异相时钟的多周期约束
实例7．3：慢时钟域到快时钟域的多周期约束
实例7．4：快时钟域到慢时钟域的多周期约束
7．3 多周期约束分析
实例7．5：同频同相时钟的多周期约束
实例7．6：快时钟到慢时钟的多周期约束
实例7．7：慢时钟到快时钟的多周期约束

第8章 虚假路径约束
8．1 虚假路径约束语法
8．2 虚假路径约束实例
实例8．1：虚假路径约束的基本应用实例
实例8．2：时序分析报告中虚假路径约束与查看

第9章 最大/最小延时约束
9．1 最大/最小延时约束语法
9．2 最大/最小延时约束实例
实例9．1：跨时钟路径的最大/最小延时约束
实例9．2：pin2pin路径的最大/最小延时约束
参考文献